Jason_Zhang

高工

今日你签到了吗?论坛动态

来自 论坛2009-11-05 14:29

RE: 提交作品的参赛队达到150,希望都取得好成绩!

这么多人参加了比赛啊。大家要加油哦,预祝各位取得好成绩……
来自 论坛2009-11-05 13:40

RE: 不要再给我加分了~~~~~~~~~~~~~

18万还多啊,好多哦。那就只能散分了哦,多给朋友们加点分,呵呵……
来自 论坛2009-11-04 22:04

ISE约束手册(分享)

ISE约束手册,Xilinx官方文档,很详细,英文版,共168页,对于在FPGA学习过程中遇到约束问题的人很有帮助。 ISE约束手册 ISE约束手册.rar……
来自 论坛2009-11-04 17:14

RE: 版主上任感言

必须表示欢迎……
来自 论坛2009-11-03 18:31

RE: DSP2812与ads1158通讯源代码!

很好,jpp辛苦啦。支持一下……
来自 论坛2009-11-03 12:41

RE: 芯片设计

芯片设计可以分为模拟IC、数字IC、RFIC、模数混合IC。 又可以分为前端和后端;设计与验证。 IC设计薪酬高,但风险也大。……
来自 论坛2009-11-03 09:34

RE: 如何用VHDL或Verilog最简洁地描述出一种逻辑功能(详见正文)

回复becoll: 加个半个时钟周期的延迟信号是为了消除a和a_onedelay相或时可能的毛刺,就是a的下降沿和a_onedelay上升沿,两个边沿相或,不知道会是什么结果,为……
来自 论坛2009-11-02 22:55

RE: 如何用VHDL或Verilog最简洁地描述出一种逻辑功能(详见正文)

哦,可以把图片再上传上来看看吗? 另外,能告知你用的是哪个仿真软件?CLK频率多少? 从行为仿真上看,是不该少一点的。……
来自 论坛2009-11-02 18:19

RE: 今年ZTE海招啊!

今年就业形势一片大好啊,我的师兄们也都已经签好了……
来自 论坛2009-11-02 16:26

RE: 异步FIFO结构(写得很好,强烈推荐)

你还只是普通会员,注册成高级会员才能下载……
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