Jason_Zhang

高工

今日你签到了吗?论坛动态

来自 论坛2009-10-29 13:43

RE: 急寻FPGA高手开发项目:用摄像头采集图像并寻找十字进行定位!谢谢!

关键在于图像处理和运动控制,还不要求高速,所以我个人觉得用FPGA不合适……
来自 论坛2009-10-29 13:18

RE: ALTERA最新上海培训资料(强烈推荐)

呵呵,上传、下载一样累啊。 没办法,合成一个压缩包的话,文件太大了,不好上传,只要小文件上传了……
来自 论坛2009-10-29 13:09

RE: 异步FIFO结构(写得很好,强烈推荐)

盖高楼真是不容易啊,盖了这么就也才66楼,人气还不够旺啊……
来自 论坛2009-10-29 13:00

RE: OFDM发射机和接收机的完整verilog代码(分享)

你已经是高级会员了啊,可以自己下嘛……
来自 论坛2009-10-28 20:56

RE: 新手想学习FPGA,但是不是知道,新手又哪个型号的芯片入门比较好?

开发板都差不多吧,要扩展性好一些的。主要根据你的钱包选择。 可惜我不卖开发板,不然就给你推荐了,呵呵。……
来自 论坛2009-10-28 18:08

RE: modelsim如何固定仿真信号显示的顺序?

把你的脚本文件中的add wave注释掉就可以了。……
来自 论坛2009-10-28 13:56

RE: modelsim是否可以保存仿真结果?

不客气,能帮到你就好。 Modelsim很好很强大,可以不支持进程重载,没法开两个Modelsim,有点遗憾。……
来自 论坛2009-10-28 13:54

RE: 信号release是一个什么状态?

这样的话,赋值高阻就可以了,就与总线断开,也就是release……
来自 论坛2009-10-28 13:52

RE: modelsim如何固定仿真信号显示的顺序?

可以啊,你把仿真结果按一定的顺序显示后,保存为wave.do文件,然后再你的脚本文件中添加do{wave.do},就可以了。这样要显示的波形的属性就保留下来了。……
来自 论坛2009-10-27 19:20

RE: 信号release是一个什么状态?

你的release不是指verilog中的force/release语句吧? 猜你的意思,release的话,赋个高阻就可以了。……
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