叮叮当当

工程师

今日你签到了吗?论坛动态

来自 论坛2007-04-25 23:02

[原创]altera杯nios设计大赛源码奉献 (三)

buildroot to build toolchain on LinuxThis post is moved to Nios Wiki, I don't recommend th……
来自 论坛2007-04-25 22:59

altera杯nios设计大赛源码奉献 (二)

最简单易懂的UCOS多任务切换例程 #include "config.h"#define TaskStkLengh 64 OS_STK T……
来自 论坛2007-04-25 22:55

Modelsim se中创建altera的仿真库

1. 路径选择 启动modelsim se仿真工具,在主窗口中选择【file】→【change directory】命令,将工作目录改变到你想存放仿真库的目录,点击【ok】. 2.……
来自 论坛2007-04-25 22:54

[原创]altera杯nios设计大赛源码奉献

[replyview] niosII button 中断 volatile int edge_capture;static void handle_button_inter……
来自 论坛2007-04-25 22:51

[原创]状态机的一种书写方式

`define S1 0`define S2 1`define S3 2`define S4 3`define S5 4`define S6 5`define S7 6`defin……
来自 论坛2007-04-25 22:50

uart的hdl设计详解

  UART(即Universal Asynchronous Receiver Transmitter 通用异步收发器)是广泛使用的串行数据传输协议。UART允许在串行链路上进行全……
来自 论坛2007-04-25 22:44

Verilog的打印系统函数

Verilog本质上也是一门高级语言,因而也提供了丰富打印信息、输出信息的系统函数。Verilog提供的打印系统函数分为三类:显示/写系统函数(Display and Write ……
来自 论坛2007-04-25 22:38

感谢管理员,以后会加油发更高质量的贴!……
来自 论坛2007-04-25 22:37

在FPGA中,我的意思是不要用 就是if else语句,如果只有if,而没有else的话,那么编译器就会把你的逻辑综合成锁存器,这样可能无法得到你所需要的逻辑。曾经就遇到过这样的……
来自 论坛2007-04-25 22:33

有问题可以加我QQ:549142561 注明:电子产品世界……
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