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今日你签到了吗?论坛动态

来自 论坛2016-12-21 17:14

RE: 《FPGA/CPLD应用设计200例》---精通这些例程，你就是专家了

好……
来自 论坛2016-12-18 11:18

RE: FPGA设计高级技巧Xilinx篇

ma……
来自 论坛2016-12-18 11:11

捕捉外部上升沿，仿真总是显示红线

使用FPGA捕捉外部某个信号的上升沿和下降沿，使用modelsim仿真，结果总是如图所示。捕捉对象是fsmc_cs，pos_cs、neg_cs是使用图2方式采集的上升沿和下降沿， ……
来自 论坛2016-12-18 11:07

RE: Verilog 代码风格规范--有一定参考性

好……
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