我觉得你没把元件例化搞明白吧，建议找本verilog语法书看看元件例化部分章节。
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module lianxi(a,b,c);
input a,b;
output c;
assign c=a |（a&b）;
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本来7月1日要更新第一篇视频教程，上周末录制了2遍，效果都不是很好，录制最后一遍时，后半段没有声音了，而且中间出现花屏，可能是我对录屏软件（Camtasia Studio 8……
