51FPGA

高工

今日你签到了吗?论坛动态

来自 论坛2013-07-05 13:18

RE: 申请CPLD DIY

好的,申请通过,进入QQ群吧,群号:321628923 现在可以下单了,http://51fpga.taobao.com ……
来自 论坛2013-07-05 10:20

RE: 一个工程中有好几个v文件,但是引脚分配只有顶层文件的引脚,其他文件的输入输出呢?

我觉得你没把元件例化搞明白吧,建议找本verilog语法书看看元件例化部分章节。 ……
来自 论坛2013-07-04 16:13

RE: 申请CPLD开发板,实现一个FIFO(先进先出存储器)控制器

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来自 论坛2013-07-03 09:31

RE: 抛砖引玉

不错,不错!……
来自 论坛2013-07-03 09:12

RE: 关于verilog 一个简单的组合逻辑问题,死活出不来结果!!!!

module lianxi(a,b,c); input a,b; output c; assign  c=a |(a&b); ……
来自 论坛2013-07-02 19:36

RE: EEPW论坛摄影挑战赛

是的哦,赶紧参与吧! ……
来自 论坛2013-07-02 15:59

RE: EEPW论坛摄影挑战赛

活动不错,顶一个! ……
来自 论坛2013-07-02 11:50

RE: 我想申请一块开发板

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