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今日你签到了吗?论坛动态

来自 论坛2010-02-26 23:40

两个always模块的变量赋值问题

接这位楼主的提问，看了许多大虾们的解答，想提问一下，考虑到a的高电平会持续一段时间。如果要求非要在a的上升沿将count清零，如何实现呢？谢谢各位的支持！！！……
来自 论坛2010-02-26 17:29

RE: Verilog_130例（分享）

好东西。。。顶楼主……
来自 论坛2010-02-26 17:27

RE: 最全面的FPGA课件（分享）

好东西啊，谢谢楼主啊！！！……
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