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今日你签到了吗?论坛动态

来自 论坛2009-12-26 09:45

RE: 怎样写testbench（权当抛砖引玉）

感谢，我现在正再找怎么写testbech的资料……
来自 论坛2009-12-26 09:23

RE: 【语言实验】《Verilog HDL程序设计教程》程序例子附件

好东西啊……
来自 论坛2009-12-26 09:18

RE: 如何用VHDL或Verilog最简洁地描述出一种逻辑功能（详见正文）

发散思维的过程……
来自 论坛2009-12-26 08:45

RE: Altera 中文手册（内部版）

谢谢。colinhouyuejun@163.com……
来自 论坛2009-12-26 08:39

RE: 如何编写高效的Testbench（分享）

谢谢……
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