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VGA/LCD控制器IP

从opencores.org下的VGA控制器ipDetails Category: Video controllerLast updated: 16/5/2003Created: ……
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ExamplesofVHDLDescriptions

Combinationa Logic Exclusive-OR Gate (Dataflow style) Exclusive-OR Gate (Behavioura style)……
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用verilog设计密勒解码器

用verilog设计密勒解码器一、题目: 设计一个密勒解码器电路二、输入信号:1. DIN:输入数据2. CLK:频率为2MHz的方波,占空比为50%3. RESET:复位信号,……
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I2C控制器的Verilog源程序

I2C 控制器的 Verilog源程序……
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EthernetIPcore(Verilog)

INTRODUCTION 1.1 ETHERNET IP CORE INTRODUCTION1.2 ETHERNET IP CORE FEATURES1.3 ETHERNET IP……
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VerilogHDLTestBenchPrimer

IntroductionOverviewThe Device Under Test (D.U.T.)The Test Bench Instantiations Figure 1……
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FPGA实现jpegVerilog源代码

FPGA实现jpeg Verilog源代码……
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8*8位的fifo数据缓冲器的VHDL源程序

编了个8*8位的fifo数据缓冲器的vhdl源程序,是经过quartusII4.2编译成功的程序。……
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USB1.1_phy(含简要说明)

USB1.1_phy(含简要说明)……
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VerilogHDL高级数字设计源码

Verilog HDL 高级数字设计源码……
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