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来自 分享下载2015-05-08 10:53

可综合的FIFO例程

该程序时可综合的FIFO32x32程序，verilog语言编写，如果学要加深或者价款的话只要修改相应的参数即可。……
来自 分享下载2015-05-08 10:53

基于FPGA的新的DDS+PLL时钟发生器

基于FPGA的新的DDS+PLL时钟发生器……
来自 分享下载2015-05-08 10:53

ispLEVER软件的破解工具

ispLEVER软件的破解工具……
来自 分享下载2015-05-08 10:53

modelsim6.3acrack免费下载

步骤：1.安装modelsim 6.3a 2.解压 licensing.rar，运行licensing.exe得到******.TXT3.在〈开始〉―modelsim 6.3a ―……
来自 分享下载2015-05-08 10:53

简易电子时钟(VHDL)

简易电子时钟(VHDL)……
来自 分享下载2015-05-08 10:53

EDA系统设计组合电路的VHDL建模

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来自 分享下载2015-05-08 10:53

初学EDA做的几个程序

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来自 分享下载2015-05-08 10:53

多功能数字钟

多功能数字钟……
来自 分享下载2015-05-08 10:53

多个FPGA芯片的原理图库

多个FPGA芯片的原理图库……
来自 分享下载2015-05-08 10:53

FPGA实验板原理图

FPGA实验板原理图……
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