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工程师

今日你签到了吗?论坛动态

来自 论坛2014-04-29 21:21

DDS教程中Testbench的疑问

这是测试激励的初始化文件,红色是不明白的地方不理解,还有老师是怎么处理addr_t = addr + phase;的思路,寄存器取值的步骤是什么? begin ……
来自 论坛2014-04-29 21:18

RE: 怎么设置fpga中有分配的管脚为三态门的状态

也可以通过脚本文件去设置……
来自 论坛2014-04-29 21:17

RE: 采样深度

采样深度怎么理解?什么意思?具体解释下。……
来自 论坛2014-04-16 21:01

RE: 强大的工具——FPGA Editor(一)

什么东西?搞的这么神秘……
来自 论坛2014-04-11 22:51

RE: ModelSim仿真教程,很详细

好东西就是要看看先……
来自 论坛2014-04-11 22:43

RE: FPGA开发板DIY活动准备工作(三)——FPGA基础篇

那就好好学习一下……
来自 论坛2014-04-08 21:03

RE: Verilog HDL如何排除错误?

编译有错 ,就是错误么,最重要的是优化……
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