加百利亚

助工

今日你签到了吗?论坛动态

来自 论坛2013-05-21 17:12

RE: 大神们,怎么能保证AD9 连接双面铺铜的过孔能被铺铜完全包裹

VIA可以全局编辑,需要覆铜全部覆盖VIA就得保证VIA全部在安全间距之内。VIA连接模式非梅花孔。……
来自 论坛2013-05-20 15:43

RE: 各位,请教BGA封装的问题

  焊盘直径 一般图纸的尺寸打8折 0.32mm球径 焊盘可以做0.3-0.25mm   过孔的话8mil 外孔 12-16mil 自己看着办   不……
来自 论坛2013-05-20 15:42

RE: 关于cadence pspice仿真实例教程

同上……
来自 论坛2013-05-20 15:41

RE: 求助!谁有A/D和D/A转换的verilog的程序呢

基于VerilogHDL的ADC0809采样控制器设计.pdf   论文啊 ……
来自 论坛2013-05-20 15:40

RE: 求助!谁有A/D和D/A转换的verilog的程序呢

啊,AD 吧时序画出来 应该就可以写出来了,至于da就更加简单了,我代码没有,可以给你看个文档……
来自 论坛2013-05-20 15:01

现在,发一个防静电PCB标志LOGO 需要的话拿去用好了

altium designer 10 +CorelDraw 搞定的 防静电标志.rar   ……
来自 论坛2013-05-17 16:44

RE: 请问,Allgero 这个参数为神马设置不了

就你那框中的四个格子数字,你随便填点,多试几下你就明白为什么了……
来自 论坛2013-05-17 16:43

RE: 等等,再问一个cadence的安装问题

  这个……你在license manager 找到lmtools --start/stop/reread 先点击stip sever 然后点击start sever ……
来自 论坛2013-05-17 16:42

RE: 临时遇到了Cadence软件问题

没有遇到过此类情况,重装一下吧。……
来自 论坛2013-05-16 16:32

RE: 遇到了Altium Desiner winter 09 卡死的问题……

那也可以用新版本的啊 百利无一害……
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