xie0jing0

工程师

今日你签到了吗?论坛动态

来自 论坛2010-04-05 10:45

xilinx 的MIG可以控制金士顿的内存条吗

请问有人用MIG控制过金士顿的内存吗,我试了试美光的好用,但很难买到正品。金士顿的东西我看了看官网上都不提供芯片的时序资料,不知道改怎么弄,希望哪位可以指点一下,不甚感激……
来自 论坛2010-04-04 09:38

RE: EEPW月度DSP与FPGA之星

又有好活动啦……
来自 论坛2010-03-23 15:10

DCM 与 PLL的级联使用?

想问一下dcm连dcm可以吗,怎样连呢? pll接dcm又是怎么样子用呢?看到有plltodcm的模块,可是不太了解用法。……
来自 论坛2010-03-10 19:57

RE: 奉献,奉献,再奉献!!

希望能申请一个!去年因为条件不符合没能申到,现在又有机会啦……
来自 论坛2010-02-09 10:17

RE: 五个ARM处理器核心verilog/VHDL源代码

正想学习呢……
来自 论坛2010-01-22 15:38

RE: 再请教一下,MIG的约束文件中IDELAYCTRL Location Constraints 怎么改呢

研究了几天问题基本解决了。 IDELAYCTRL 模块是为IDELAY模块服务的。DDR2中的u_iodelay_dq_ce用到了IDELAY模块,也就需要相应的IDELAYCT……
来自 论坛2010-01-22 09:07

RE: 再请教一下,MIG的约束文件中IDELAYCTRL Location Constraints 怎么改呢

偶是按照板子的IO分配改过它的引脚分配的,结果就遇到问题了。……
来自 论坛2010-01-21 10:21

再请教一下,MIG的约束文件中IDELAYCTRL Location Constraints 怎么改呢

首先谢谢板上的高手, 还想请教下,MIG产生的ucf文件里,IDELAYCTRL Location Constraints 怎么改呢 针对一个开发板我有IO和其他的位置分配,唯……
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